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Aceleración de Algoritmos mediante Hardware Reconfigurable

Aceleración de Algoritmos mediante Hardware Reconfigurable

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Detalles del libro:

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Año:2012
Editor:CUJAE
Páginas:147 páginas
Idioma:español
Desde:19/06/2013
Tamaño:4.06 MB
Licencia:Pendiente de revisión

Contenido:

La presente tesis, titulada "Aceleración de Algoritmos Mediante Hardware Reconfigurable: Biblioteca de Procesamiento de Imágenes para System Generator", desarrolla una biblioteca de procesado de imágenes para el flujo de diseño basado en modelos de System Generator. Este flujo permite la implementación de sistemas de procesado de una manera sencilla y efectiva.

El diseño de la biblioteca se basa en el paralelismo de ejecución de los algoritmos de convolución de imágenes y de ordenamiento de píxeles, potenciando la implementación de estos sistemas en arreglos de compuertas programables (FPGA). Además, ésta utiliza métodos de optimización de los algoritmos de procesado desde la parametrización de las versiones genéricas hasta el uso de filtros específicos.

Por último, la efectividad de los bloques de la biblioteca de procesado es comprobada utilizando un sistema de procesado para segmentación de imágenes con XSGImgLib.

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